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為什么采用聚合物鋁電解電容器可以解決電源設(shè)計(jì)的痛點(diǎn)？
在設(shè)計(jì) USB 電源以及電子系統(tǒng)和子系統(tǒng)（包括 IC、特定應(yīng)用 IC (ASIC)、中央處理器 (CPU) 和現(xiàn)場可編程門陣列 (FPGA)）的功率輸送解決方案時(shí)，設(shè)計(jì)人員會(huì)不斷尋找方法來提高效率，同時(shí)確保以緊湊的外形尺寸在寬溫度范圍內(nèi)提供穩(wěn)定、無噪聲的功率。他們需要提高效率、穩(wěn)定性和可靠性，降低成本，并縮小解決方案的外形尺寸。同時(shí)，還必須滿足應(yīng)用中不斷增多的功率性能要求，包括平滑處理電源電路的輸入和輸出電流、支持峰值功率需求以及抑制電壓波動(dòng)。
2024-03-15
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利用FPGA進(jìn)行基本運(yùn)算及特殊函數(shù)定點(diǎn)運(yùn)算
FPGA以擅長高速并行數(shù)據(jù)處理而聞名，從有線/無線通信到圖像處理中各種DSP算法，再到現(xiàn)今火爆的AI應(yīng)用，都離不開卷積、濾波、變換等基本的數(shù)學(xué)運(yùn)算。但由于FPGA的硬件結(jié)構(gòu)和開發(fā)特性使得其對(duì)很多算法不友好，之前本人零散地總結(jié)和轉(zhuǎn)載了些基本的數(shù)學(xué)運(yùn)算在FPGA中的實(shí)現(xiàn)方式，今天做一個(gè)系統(tǒng)的總結(jié)歸納。
2024-02-21
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如何用內(nèi)部邏輯分析儀調(diào)試FPGA？
進(jìn)行硬件設(shè)計(jì)的功能調(diào)試時(shí)，FPGA的再編程能力是關(guān)鍵的優(yōu)點(diǎn)。CPLD和FPGA早期使用時(shí)，如果發(fā)現(xiàn)設(shè)計(jì)不能正常工作，工程師就使用“調(diào)試鉤”的方法。先將要觀察的FPGA內(nèi)部信號(hào)引到引腳，然后用外部的邏輯分析儀捕獲數(shù)據(jù)。然而當(dāng)設(shè)計(jì)的復(fù)雜程度增加時(shí)，這個(gè)方法就不再適合了，其中有幾個(gè)原因。第一是由于FPGA的功能增加了，而器件的引腳數(shù)目卻緩慢地增長。因此，可用邏輯對(duì)I/O的比率減小了，參見圖1。此外，設(shè)計(jì)很復(fù)雜時(shí)，通常完成設(shè)計(jì)后只有幾個(gè)空余的引腳，或者根本就沒有空余的引腳能用于調(diào)試。
2024-02-04
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實(shí)現(xiàn)最高效的數(shù)據(jù)轉(zhuǎn)換：深入了解Achronix JESD204C解決方案
長期以來，Achronix為不同行業(yè)的數(shù)據(jù)密集型和高帶寬應(yīng)用提供了創(chuàng)新性的FPGA產(chǎn)品和技術(shù)，并幫助客戶不斷打破性能極限。其中一些應(yīng)用需要與先進(jìn)的模擬/數(shù)字轉(zhuǎn)換器（ADC）和數(shù)字/模擬轉(zhuǎn)換器（DAC）進(jìn)行對(duì)接——可由JESD204C完美地完成這項(xiàng)任務(wù)。
2023-12-27
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基于STEP FPGA的旋轉(zhuǎn)編碼器電路驅(qū)動(dòng)
旋轉(zhuǎn)編碼器是用來測(cè)量轉(zhuǎn)速的裝置，因其人性化的操作被用于越來越多的電子設(shè)備中，旋轉(zhuǎn)編碼器有多種分類：以編碼器工作原理可分為：光電式、磁電式和觸點(diǎn)電刷式。以碼盤刻孔方式不同分為：增量式和絕對(duì)式兩類。
2023-11-29
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一種基于電流源基準(zhǔn)型LDO的放大器供電時(shí)序電路的應(yīng)用
相信你們?cè)谠O(shè)計(jì)電路中經(jīng)常會(huì)碰到有時(shí)序要求的電路，比如說FPGA數(shù)字電路的供電，比如我們給模擬放大器的供電，等等。通常來說，我們有sequencers這種產(chǎn)品，其中又分為模擬時(shí)序控制芯片和數(shù)字時(shí)序控制芯片；模擬時(shí)序控制芯片，將電源輸出電壓作為輸入信號(hào)，實(shí)時(shí)監(jiān)測(cè)電源輸出，當(dāng)電源輸出達(dá)到閾值時(shí)，會(huì)給一個(gè)類似于power good的電平信號(hào)，這樣可以將這個(gè)電平信號(hào)控制下一級(jí)電源的EN，從而控制下一級(jí)電源電路的開啟，從而達(dá)到時(shí)序控制的目的。
2023-11-10
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用FPGA構(gòu)建邊緣AI推理應(yīng)用很難？這樣做，變簡單！
對(duì)于希望在邊緣的推理處理器上實(shí)施人工智能 (AI) 算法的設(shè)計(jì)人員來說，他們正不斷面臨著降低功耗并縮短開發(fā)時(shí)間的壓力，即使在處理需求不斷增加的情況下也是如此?，F(xiàn)場可編程門陣列 (FPGA) 為實(shí)施邊緣AI所需的神經(jīng)網(wǎng)絡(luò) (NN) 推理引擎提供了特別有效的速度和效率效率組合。然而，對(duì)于不熟悉 FPGA 的開發(fā)人員來說，傳統(tǒng)FPGA的開發(fā)方法可能相當(dāng)復(fù)雜，往往導(dǎo)致他們?nèi)ミx擇不太理想的解決方案。
2023-11-02
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如何實(shí)現(xiàn)高效的供電網(wǎng)絡(luò) (PDN) 設(shè)計(jì)
在為 5G 應(yīng)用設(shè)計(jì)電源系統(tǒng)時(shí)，設(shè)計(jì)人員必須考慮此類應(yīng)用固有的寬頻率范圍，從穩(wěn)壓器中的中頻到 FPGA內(nèi)核中的高時(shí)鐘頻率。這種端到端的全雙工設(shè)計(jì)對(duì)于優(yōu)化電源、電源轉(zhuǎn)換和配電過程的性能至關(guān)重要。
2023-10-30
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Microchip FPGA采用量身定制的PolarFire FPGA和SoC解決方案協(xié)議棧
為智能邊緣設(shè)計(jì)系統(tǒng)正面臨前所未有的困難。市場窗口在縮小，新設(shè)計(jì)的成本和風(fēng)險(xiǎn)在上升，溫度限制和可靠性成為雙重優(yōu)先事項(xiàng)，而對(duì)全生命周期安全性的需求也在不斷增長。要滿足這些同時(shí)出現(xiàn)的需求，需要即時(shí)掌握特殊技術(shù)和垂直市場的專業(yè)知識(shí)。沒有時(shí)間從頭開始。Microchip Technology Inc.（美國微芯科技公司）今日宣布在其不斷增長的中端FPGA和片上系統(tǒng)（SoC）支持系列產(chǎn)品中增加了九個(gè)新的技術(shù)和特定應(yīng)用解決方案協(xié)議棧，涵蓋工業(yè)邊緣、智能嵌入式視覺和邊緣通信。
2023-10-11
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如何為Lattice CertusPro-NX FPGA評(píng)估板優(yōu)先考慮效率和成本
現(xiàn)代現(xiàn)場可編程門陣列(FPGA)系列（如Lattice Semiconductor CertusPro?-NX）適用面廣泛，但需滿足根據(jù)特定市場驅(qū)動(dòng)的需求而定制的電源要求。如果不清楚該如何平衡成本、性能和尺寸這三個(gè)要素，則可能難以為這些器件選擇合適的供電方式。本文介紹了適用于CertusPro-NX評(píng)估板的解決方案，同時(shí)針對(duì)特定需求闡明了各種解決方案實(shí)現(xiàn)優(yōu)化的原理和原因。μModule?電源解決方案尺寸小巧、設(shè)計(jì)簡單，為FPGA系統(tǒng)提供了一種非常實(shí)用的設(shè)計(jì)方法，但還有其他選項(xiàng)可供電源系統(tǒng)架構(gòu)師考慮。
2023-09-28
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搭建硬實(shí)時(shí)系統(tǒng)太難了？用它試一下！
現(xiàn)場可編程門陣列 (FPGA)、支持 Linux 的RISC-V 微控制器單元 (MCU) 子系統(tǒng)、先進(jìn)的存儲(chǔ)器架構(gòu)和高性能通信接口，是設(shè)計(jì)人員的重要工具。對(duì)于安全互聯(lián)系統(tǒng)、安全關(guān)鍵型系統(tǒng)，以及人工智能 (AI) 和機(jī)器學(xué)習(xí) (ML) 等各種硬實(shí)時(shí)確定性系統(tǒng)的設(shè)計(jì)人員，更是如此。
2023-09-25
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通信 工業(yè)和嵌入式光通信技術(shù)進(jìn)步背后的推動(dòng)力
隨著工業(yè)和嵌入式計(jì)算對(duì)通信距離、低功耗和小型配置需求的提高，對(duì)通信帶寬也提出了更高的要求。而FPGA等特定使能技術(shù)以及收發(fā)器、連接器和接收器的進(jìn)步也為光通信技術(shù)的快速發(fā)展提供了支持。
2023-09-20
- 貿(mào)澤與Cinch聯(lián)手發(fā)布全新電子書深入探討惡劣環(huán)境中的連接應(yīng)用
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